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MAX19516

Dual-Channel, 10-Bit, 100Msps ADC

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SYNCIN

2x INPUT CLK

4x INPUT CLK

1x DIVIDED CLK

(STATE)

1x DIVIDED CLK

(STATE)

SUV

= SET-UP TIME FOR VALID CLOCK EDGE.

= HOLD-OFF TIME FOR INVALID CLOCK EDGE.

DIVIDE-BY-2 EDGE SYNCRONIZATION

SUV

1234

(1) (0) (1) (0) (1) (0) (1) (0) (1)(1) (0)(1) (0)

FORCE TO 0

(1) (0) (1) (0) (1) (0) (1) (0) (1) (0) (1)(0)(0)

DIVIDE-BY-4 EDGE SYNCHRONIZATION

(0) (1) (2) (3)(0) (1) (2) (3) (0) (1) (2) (3) (0) (1)

(0) (1) (2) (3) (0) (1) (2) (3) (0) (1)(1) (2) (3) (0)

(0) (1) (2) (3) (0) (1) (2) (3) (0) (1)(2) (3) (0) (1)

(0) (1) (2) (3) (0) (1) (2) (3) (0) (1)(3) (0) (1) (2)

Figure 12. Edge Synchronization Mode

1 2 ... 22 23 24 25 26 27 28 29 30 31 32 33 34

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